Procesador Allen-Bradley 1747-L514 SLC 5/01
$123.00
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Descripción
Procesador Allen-Bradley 1747-L514 SLC 5/01
El Allen-Bradley 1747-L514, también catalogado como el Procesador 1747-L514 SLC 5/01, sirve como el módulo CPU principal SLC 5/01 utilizado para ejecutar el control de escaneo cíclico, la gestión de la tabla de imagen de E/S y la coordinación de la red DH-485 en los sistemas modulares de chasis SLC 500 de Rockwell Automation . El procesador funciona como controlador en la ranura 0 con ejecución de memoria integrada y manejo de comunicación serial embebida.
Desglose de sufijos y matriz de modelos
El modelo base 1747-L514 no incluye segmentación funcional por sufijos. Es una variante de procesador SLC 5/01 de configuración fija con 4K de memoria de usuario e interfaz de comunicación DH-485 integrada.
Especificaciones de hardware
| Parámetro | Especificación |
|---|---|
| Modelo | 1747-L514 |
| Marca | Allen-Bradley |
| Origen | EE.UU. |
| Peso | 0.34 kg |
| Temperatura de operación | 0 a 60 °C |
| Consumo de energía | 90 mA @ 5 VDC corriente del backplane |
| Tipo de producto | Módulos procesadores SLC 5/01 |
| Memoria de programa | 4K palabras de usuario |
| Tiempo de escaneo de programa | 8 ms |
| Tiempo de escaneo de E/S | 2.6 ms |
| E/S máxima | 960 puntos |
| Soporte de chasis | Hasta 3 chasis / 30 ranuras |
Ejecutación del bus backplane y arquitectura de control DH-485
Dentro de los sistemas backplane SLC 500 de Rockwell Automation , el 1747-L514 ejecuta control determinista basado en escaneo usando RAM respaldada por condensador para la ejecución cíclica del programa. El procesador ocupa la ranura 0 y coordina todos los módulos de E/S mediante la sincronización de la tabla de imagen del backplane.
La interfaz DH-485 integrada funciona como un nodo de comunicación serial basado en token, soportando intercambios maestro/esclavo para programación, monitoreo y transferencia de datos a través de entornos RSLogix 500. La arbitraje del backplane asegura que las actualizaciones de E/S se sincronicen en intervalos de escaneo definidos, con un tiempo de escaneo de E/S de 2.6 ms y ciclos de ejecución de programa de 8 ms bajo carga nominal.
La arquitectura de memoria se divide entre espacio volátil para ejecución de programa (4K instrucciones) y almacenamiento de retención respaldado por EEPROM mediante módulos de expansión 1747-M1/M2, permitiendo la retención estructurada del programa a través de ciclos de energía sin dependencia de ejecución en memoria no volátil.
Preguntas frecuentes (FAQ)
P: ¿El 1747-L514 soporta intercambio en caliente en el chasis SLC 500?
R: No. El procesador debe ser insertado o retirado con la alimentación del chasis apagada para evitar corrupción de señales en el backplane.
P: ¿Cuál es la función de la asignación de la ranura 0?
R: La ranura 0 define la posición principal de la CPU responsable de la arbitraje del backplane y la coordinación de la tabla de imagen de E/S en todos los módulos.
P: ¿Puede la interfaz DH-485 operar independientemente del ciclo de escaneo de la CPU?
R: No. La comunicación DH-485 está sincronizada con la ejecución del procesador y depende de la programación de la CPU y el servicio del backplane.
Guías de instalación en campo
El módulo debe instalarse exclusivamente en la ranura 0 de un chasis 1746. Los conectores del backplane deben estar completamente asentados para asegurar la correcta alineación de 5 VDC y del bus de comunicación antes de aplicar energía.
El cableado DH-485 debe seguir prácticas de enrutamiento con par trenzado blindado con terminación y puesta a tierra correctas en un solo punto de referencia. El enrutamiento del cable debe estar separado de conductores de alto ruido para mantener la integridad de la señal serial.
Los módulos de memoria EEPROM, si se usan, deben insertarse solo con el equipo desenergizado para evitar la corrupción de los datos almacenados del programa.
Características
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